[00646867]数字电荷耦合逻辑(DCCL)加法器研制
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技术详细介绍
近年来人们一直在研究如何将ＣＣＤ优秀器件用于数字计算机的问题。７６年年国际上有所突破，而在集成电路中形成了新的分支－ＤＣＣＬ。但目前国际上提出的ＤＣＣＬ全加器存在着结构复杂、时钟脉冲多而复杂的缺点。南京大学提出了对ＤＣＣＬ全加器的改进设想，并在国内首次制成了ＤＣＣＬ二位加法器，观察到加法器的全部功能。改进后的全加器存贮栅从７个减至４个，时钟脉冲从４个以上减至３个，且其中两个和一般两相ＣＣＤ的时钟脉冲完全一致。这不仅给制造和使用带来的方便，而且对发展ＣＣＤ与ＤＣＣＬ相结合的单片计算机有重要意义。